Anccend
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- 现在只有一份源文件，就在 pipelined-cpu/ 下：
srcs/rtl（13 个处理器 RTL）、srcs/board、srcs/constrs、srcs/tb、srcs/rom、
tools/（rv_asm.py、hex2vh.py、run_regress.ps1）、programs/（汇编源码与期望值）。
仓库根目录的 rtl/、board/、testbench/、tools/ 已删除（删除前逐个文件比对过 MD5，
与工程目录里的副本完全一致），说明文档仍放在最外层
cpu21_riscv_redirect_int_bpb说明.md。
- .gitignore 改为：忽略 pipelined-cpu/ 下的工程生成物（*.xpr、*.runs、*.sim、*.cache…），
只跟踪 srcs/、tools/、programs/、create_project.tcl；_tmp/、_vivado/ 等本地临时目录
继续忽略。
- 新增 tools/run_regress.ps1：一键回归脚本。编译 srcs/rtl/ → 跑 muldiv/isa/lui/mmio
四个指令测试并与 programs/*.expected 逐值比对 → 跑两个流水基线 → 跑板级顶层
（-d BOARD_ROM_FAST）检查跑马灯，最后汇总 PASS/FAIL 并返回失败数作为退出码。
编译与仿真的中间文件写在 %TEMP%\cpu21_regress，不污染工程目录。实测全部通过。
- 新增 programs/board_demo_fast.asm：快速版演示程序（延时初值 64，约 2.6 µs/步），
对应 srcs/board/cpu21_board_rom_fast.vh；仿真时用 -d BOARD_ROM_FAST 才会选到它。
- 两个测试平台增加 srcs/rom 探测路径，工程目录内直接 Run Simulation 即可加载镜像。
- 文档：目录结构一节按新布局重写；新增“回归测试”一节（脚本用法 + 期望基线数字）；
上板章节的生成/仿真命令改为相对工程目录（python tools/rv_asm.py programs/…、
xvlog -d BOARD_ROM_FAST srcs/rtl/*.v …）；tools 里的用法示例同步更新；
“工程分享”一节去掉已不存在的副本同步说明。
- 清理：删除本地 _tmp/（约 57 MB）、_vivado/、.Xil/ 临时目录。
26 lines
1.1 KiB
NASM
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NASM
# MMIO 验证程序：写 LED 寄存器（0x0000_1000）-> 读回 -> 字节写 -> 再读回。
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# 期望 LED 输出顺序（共 5 次，见同目录 mmio_test.expected）：
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# ① 12345678 sw 0x12345678
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# ② 12345678 lw 读回后 print（print = lui t6 + sw a0,0(t6)，本身就是一次 MMIO 写）
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# ③ ffffffff sw 0xffffffff
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# ④ ffff7fff sb 0x7f 覆盖 led[15:8]
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# ⑤ ffff7fff 读回后 print
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# 用法：python tools/rv_asm.py testbench/programs/mmio_test.asm <仿真工作目录>/risc-v-benchmark_ccab.hex
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lui t0, 0x1 # t0 = LED_ADDR = 0x00001000
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lui t1, 0x12345
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addi t1, t1, 0x678 # t1 = 0x12345678
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sw t1, 0(t0) # ① MMIO 写 LED
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lw a0, 0(t0) # MMIO 读回
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print # ② 应为 12345678
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addi t2, zero, -1 # t2 = 0xffffffff
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sw t2, 0(t0) # ③ 应为 ffffffff
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addi t3, zero, 0x7f
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sb t3, 1(t0) # 字节写：led[15:8] = 0x7f
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lw a0, 0(t0) # 读回
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print # ④ 应为 ffff7fff
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halt
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