Anccend/risc-v-cpu
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Alpha 1e5cb54c00 docs(readme): 记录上板实测出来的 PS/2 方向约定（鼠标 dy 取负） 
上板已经确认：不定负号的表现就是“左右正常、上下反向”，不是解码错；
另外把“键鼠静止时一个字节都不发”写成显式提醒，避免再被误判成硬件坏。
 2026-09-23 22:50:29 +08:00
Alpha 9dfff16794 feat(board): 支持 PS/2 键盘（与鼠标共用板载 USB HID 口），并修好 PS/2 帧校验 
一、修 PS/2 接收器的真 bug —— 这就是上板“鼠标毫无反应”的根因
  鼠标和键盘两个接收模块原来是同一个写法错误：
  * 帧用整体右移 {data, frame_q[10:1]}，判 frame_q[10] 时停止位还没移进来，判到的
    其实是校验位；取数据 frame_q[8:1] 也因此整体错一位
  * 校验位按“偶校验”判，而 PS/2 是“奇校验”
  两者叠加让真设备发来的帧 100% 被丢掉（上板表现为 rx_count 恒为 0，看起来像硬件
  或跳线问题）。现在按“位的下标”存帧（frame_q[i] = 第 i 位，所以字节 = frame_q[8:1]、
  校验 = frame_q[9]），停止位直接在当前拍的 ps2_data 上判，校验按奇校验。

二、新增 PS/2 键盘解码 cpu21_ps2_kbd.v
  扫描码集 2：E0 = 扩展前缀、F0 = 松开前缀，只对“按下”产生事件，并映射成与鼠标
  完全相同的事件格式（↑↓←→ = dy/dx ±8，正好一格；Enter/空格 = 左键；左 Shift/F/C
  = 右键 = 插旗），所以 saolei 的 C 代码一行都不用改；按住方向键 = 连续移动（用的是
  键盘自己的重复码）。

三、顶层 cpu21_board_top：用 SW15 选设备
  同一根 PS/2 线上只会插一个设备，但两个解码器都在听：键盘的扫描码会凑巧组成
  “合法的鼠标包”，两路同时生效会让光标乱跳。因此新增端口 hid_sel(SW15)：
  0 = 键盘（默认），1 = 鼠标；诊断 LED 改显示“当前选中设备”收到的字节数。

四、其它
  * XDC：hid_sel -> V10（SW15），引脚号在官方母版里核对过
  * tb_board_top 补 hid_sel 端口，避免悬空
  * 新增自测 srcs/tb/tb_ps2_mouse.v / tb_ps2_kbd.v：含“故意发一个校验位错的帧，
    必须丢帧”的用例，两个都 ALL PASS
  * README / saolei/README：新增“PS/2 键鼠”一节（接线方式、SW15、LED 诊断口诀、
    键位表），修正显存格式（每格 2 字节、0x2000-0x2FFF）、扫雷难度与验证状态、
    修好 riscv 工具链 -Prefix 路径
 2026-09-23 22:35:50 +08:00
Anccend cfcf2f4923 feat(saolei): 显存扩成每格 2 字节 + 内置 A-Z 字模；开始界面加文字、难度选择和黑背景 
显示（RTL）
- cpu21_vga.v：显存从"每格 1 字节"改成"每格 2 字节"（第 1 字节是 6 位字形、
  第 2 字节是 3 位颜色），字地址由 cidx[10:2] 改为 cidx[10:1]（1 字 = 2 格）；
  字模表由 4 位扩到 6 位（0..63），新增 A-Z 大写字母（16..41），原 0..15 的
  数字/雷/旗/问号/横线/实心字形不变
- cpu21_mmio.v：显存窗口 0x2000-0x27FF -> 0x2000-0x2FFF（300 -> 600 字），
  fb_widx 相应取 addr_i[11:2]
- cpu21_board_top.v：FB_WORDS 300 -> 600（1200 -> 2400 字节）

软件
- mmio.h：fb_write() -> fb_write_cell(idx, glyph, color)（一格写两个 sb）；
  删掉 CELL()，新增 G_A..G_Z 字形常量
- saolei.c：draw_cell / clear_screen 改用 fb_write_cell；开始界面显示
  MINES / EASY / NORMAL / HARD / START 文字（START 直接写在绿色按钮条上），
  不再是"两排雷图案 + 纯色条"
- 难度选择：新增 g_difficulty / g_mines，三档 20 / 40 / 60 雷；place_mines、
  胜利用的 opened_cnt 比较、toggle_flag 的剩余雷数都改读 g_mines；点难度那一行
  即切换并重画菜单，点 START 才把雷数交给关卡
- 全部索引运算仍只用移位/掩码（棋盘固定 16x16），没有引入除法

配色（修"数字 1 看不见"）
- 数字 1 用 C_BLUE、游戏背景原来也是 C_BLUE，调色板里是同一个深蓝，所以数字 1
  完全看不见；现在菜单与关卡背景统一改成 C_BLACK，胜负闪动仍是绿/红/黑，
  数字本身的配色不动

工具与文档
- build.ps1：Python 启动器兼容 —— 有 py 用 py，没有就回退到 python
  （本机只有 python，之前 check_isa.py / elf2hex.py 两处都会中断）
- saolei/README.md：显存表（0x2000-0x2FFF、每格 2 字节）、格子编码（6 位字形、
  16..41 是 A-Z）、难度说明同步更新
- README.md / cpu21_board_top.v：仅格式化工具重排（Markdown 表格对齐、
  if/else 合并成一行），无语义变化

验证：build.ps1 全流程通过（972 条指令 ISA 检查全过；text=3888 B / data=0 /
bss=1444 B；入口 _start=0x0、isr1/2/3=0x100/0x200/0x300）；xvlog 不带宏与带
SAOLEI_ROM 两种配置编译均无错；tools/check_rtl_text.ps1 体检 OK。
未验证：未跑行为仿真、未上板。
 2026-09-23 19:23:45 +08:00
Alpha db0a174bb7 docs: 仿真演示步骤补上 _tmp 目录的创建命令，复制粘贴即可跑 2026-09-19 20:34:10 +08:00
Alpha 694446d8f0 docs: README 补上扫雷烧板步骤与无显示器仿真演示命令 
- 新增「扫雷：怎么烧到板上」：build.ps1 + create_project_saolei.tcl + 板上按键表
- 新增「扫雷：没有 VGA 显示器怎么玩」：xvlog/xelab/xsim 三条命令、play_saolei.tcl 的
  k c / k u / k f 操作、每步自动出 PNG（shots/NNN_<按键>.png 与 shots/latest.png）
- 顺带清理工作区临时产物（_tmp 下的 dump/png/log、.Xil、vivado.jou/log）
 2026-09-19 20:33:14 +08:00
Anccend f7844b7b1c feat(board): 中断综合测试程序上板 + 可变分频/刷新率；README 大幅扩写 
板级顶层（srcs/board/cpu21_board_top.v）
- ROM 增加 RISC_V_INTRUPT_CCAB_ROM 分支，中断入口 0x0AC/0x1E4/0x308；
  与 SAOLEI_ROM / BOARD_ROM_FAST / 默认跑马灯构成 ifdef 链
- 新增参数 CLK_DIV_INTRUPT：跑中断测试程序时用更慢的 CPU 时钟（默认 32
  = 3.125 MHz），让数码管上每个数值停留约 160 ms 便于观察
- 数码管扫描分频随 CPU 分频缩放（SEG_REFRESH_DIV = 100000/CPU_DIV），
  保证每位数码管仍是 125 Hz（不闪）；数码管改显示 MMIO 的 led_data；
  LED[2:0] 改为锁存式中断指示（请求上升沿点亮、对应 ISR 执行 uret 后熄灭）
- 复位同步器/led_we 指示等注释同步更新；srcs/rtl/cpu21_seg7.v 分频计数
  加宽到 20 位以容纳随主频变化的 REFRESH_DIV

工具与程序
- tools/adapt_intrupt_ccab.py：把课程中断测试镜像适配成上板 ROM。六处适配
  （ISR 停机 ecall、显示改 MMIO+DISP_DLY、ISR2/ISR3 出栈顺序、ISR3 SB 测试
  用未保存寄存器、ISR 破坏 ra 的 DISP_DLY_ISR），全部 2 字换 2 字，
  不移动任何指令地址；带断言与 jal 目标自检
- programs/risc-v-intrupt-ccab.asm/.hex：课程中断综合测试程序（含六处适配说明）
- create_project.tcl：新增 use_intrupt_ccab / use_saolei 开关，自动把对应
  ROM 头文件按 Verilog Header 加入 sources_1 并定义宏
- tools/rars_f0c874c.jar：课程 RARS 汇编器移到 tools/

文档（README.md）
- 新增"各模块的实现方式"：按流水线主体 / 外设 / 板级逐模块讲实现要点
- 新增"内置程序与宏的用法"：ROM 宏表（含各自的中断入口）、GUI/Tcl/命令行
  三种定义方式、中断程序的适配流程与仿真验证方法
- 新增"分频与刷新率一览"：CLK_DIV / CLK_DIV_INTRUPT / SEG_REFRESH_DIV /
  led_we 时长 / DISP_DLY 延时常量分别在哪里改、怎么换算
- 修正引脚表（LED[2:0] 中断指示、led_we 0.34 s、CPU_DIV）与 ROM/RAM 说明
  （ROM 8192 字 = 32 KB），补充中断程序上板现象与 ROM 头文件清单

验证：不带宏 / 带 RISC_V_INTRUPT_CCAB_ROM 两种配置 xvlog 编译均无错误；
三路嵌套与 IRQ3 抢占 ISR1 的仿真通过（level 逐级升降、uepc 正确恢复、
halted=0）；tools/check_rtl_text.ps1 体检 OK。
 2026-09-19 15:44:47 +08:00
Alpha f50639e90f feat(saolei): 新增纯 C 扫雷（MMIO 显示 + 中断读鼠标），扩展 CPU 外设并清理仓库 
## 背景

在原有五级流水 CPU 的基础上，用一颗 RISC-V 工具链把"纯 C 写的扫雷"编译成机器码
固化进片内 ROM 运行，并为此把 MMIO 外设从"只有一个 LED 寄存器"扩展成
显示（VGA 显存）+ 七段数码管 + 鼠标事件（含中断）的完整子系统。
原 LED MMIO 的语义保持不变，原有跑马灯/中断/指令回归不受影响。

## 硬件（pipelined-cpu/srcs）

- cpu21_mmio.v：扩展成 MMIO 中枢，新增
  * 七段数码管寄存器（0x1004，8 位十六进制）
  * 鼠标寄存器组（0x1100+）：STATUS/DATA/ACK/CTRL/INPUT/TIME/FRAME/EVCNT/LEVEL/MAGIC
    —— 含 16 项事件 FIFO 与 mouse_irq_o（读空自动回 0，不丢事件）
  * 显示控制器（0x1140+）：CTRL（光标可见/背景色）、CURSOR（列、行）
  * 显存窗口（0x2000-0x27FF）：写端口输出到板级顶层的双口 RAM，读保持组合读
  * LEVEL（0x1120）：软件中断寄存器，写 1 拉起 level_irq_o（用作"关卡入口"）
  * 地址译码、字节写合并、读数据 mux 全部按原风格实现
- 新增外设 RTL：cpu21_vga.v（640x480@60 按格子扫描，8x8 字模放大 2 倍）、
  cpu21_seg7.v（8 位数码管动态扫描）、cpu21_pointer.v（5 向按键→鼠标事件，1 ms 去抖
  + 事件排队）、cpu21_ps2_mouse.v（可选真鼠标，PS/2 11 位帧接收 + 3 字节包解析）
- cpu21_riscv_redirect_int_bpb.v：新增外设总线端口（显存写/读回、鼠标事件输入、
  中断输出、数码管数据、帧脉冲），例化扩展后的 cpu21_mmio
- cpu21_board_top.v：接入显存双口 RAM + VGA + 数码管 + 鼠标事件源，中断接线为
  irq_i = {SW2, LEVEL|SW1, 鼠标|SW0}；ROM 宏切换（定义 SAOLEI_ROM 加载扫雷程序）；
  ROM_WORDS 1024→8192
- cpu21_board_top.xdc：新增按键、SW[3]、8 位数码管、VGA、PS/2 的全部引脚约束
- tb_board_top.v：新端口显式接 0/1，避免悬空影响原跑马灯回归
- create_project.tcl：把 cpu21_saolei_rom.vh 按 Verilog Header 条件加入

## 软件（saolei/）

- sw/mmio.h：全部 MMIO 地址与格子编码（换地址只改这一个文件）
- sw/saolei.c：纯 C 扫雷 —— 背景"伪操作系统" main()（开始界面）+ 关卡 level_main()
  （在 IRQ1 里跑完整局）+ 棋盘位图/布雷（首点安全）/BFS 展开/插旗/胜负判定/逐格绘制
- sw/isr.c：**中断读鼠标的代码**。三个固定地址入口：
  * isr1_entry（.text.isr1=0x100）关卡入口：保存全部调用者保存寄存器 +
    csrrsi 打开 MIE（让鼠标中断可嵌套）→ level_main
  * isr2_entry（.text.isr2=0x200）鼠标读取：只存 ra → 纯 C 主体 isr_body
  * isr3_entry（.text.isr3=0x300）备用：直接 uret
- sw/start.c：设 sp、清 .bss、进 main（只有这一处必要内联汇编）
- sw/linker.ld：复位 0x0、三个中断入口 0x100/0x200/0x300、栈顶 0x0FFC；
  用 ASSERT 禁止 .data/.rodata（这颗核读不到 ROM 里的数据）

## 构建与工具链适配（saolei/tools）

- build.ps1：一键 C → .o → ELF → .hex + cpu21_saolei_rom.vh，任一步失败立刻停止
- check_isa.py：用"指令白名单"逐条检查反汇编，出现本核未实现的指令即报错并给修复提示
- elf2hex.py：裸二进制 → $readmemh hex + ROM 初始化头文件
- 三处针对本核的关键配置（都已写进脚本注释）：
  1) -march=rv32im_zicsr（GCC 15 起 rv32im 不含 Zicsr，csrrsi 会报错）
  2) 不能禁链接器松弛：gcc 函数调用默认是 auipc+jalr，靠松弛压成 jal，
     禁掉后 35 条 auipc 会留在代码里（本核没有 auipc）；
     用 -msmall-data-limit=0 防止松弛引入 gp 相对寻址
  3) 中断入口地址必须写在段声明上（.text.isr1 0x100 : ...），
     只写 ". = 0x100;" 会被 ld 忽略（实测 isr1 掉到了 0x14）
- 实测结果：text=3368B、data=0、bss=1436B，842 条指令全部通过 ISA 检查，
  入口地址 _start=0x0 / isr1_entry=0x100 / isr2_entry=0x200 / isr3_entry=0x300

## 仓库清理

- 删除被工程取代的 saolei/hw、saolei/constrs（外设已并入 srcs/rtl）
- 删除全部 Vivado 生成物：.xpr、.runs、.sim、.cache、.hw、.ip_user_files、.Xil、
  vivado.jou/log —— 需要工程时用 source create_project.tcl 一键重建（约 0.3 MB 源文件）
- .gitignore 增加 saolei/build/（构建产物可一键重建）

## 文档

- README：更新目录结构、仓库约定（不放生成物）、MMIO 地址表、文件与模块划分表、
  上板说明，新增"扫雷程序（saolei/）"章节
- saolei/README.md：重写 —— 程序结构（背景/关卡/鼠标 + 三个中断入口）、
  本核指令子集与对应写法、构建步骤与实测数据、MMIO 地址表、上板/仿真步骤、
  操作说明、验证状态与已知可改进项

## 验证状态（如实说明）

- 已实测：C 工具链链路（编译/链接/ISA 检查/hex 生成/入口地址逐条核对）
- 未验证：所有 RTL 未经综合与仿真（本机无 Vivado），C 程序也未在仿真器/硬件上运行过；
  建议先跑 tools/run_regress.ps1 确认原回归仍全 PASS，再用 SAOLEI_ROM 宏做行为仿真
 2026-09-16 20:11:00 +08:00